四位移位電路

① 用4位雙向移位寄存器實現自動載入4位並行數據，輸出4位串列數據，高位在前，求電路原理圖

1）實現自動載入，何意？是指加電時也還沒有移位脈沖輸入時嗎？

2）高位在前，何意？是指高位先移出嗎？

② 4位雙向通用移位寄存器74LS194的程序描述

寄存器 在數字電路中，用來存放二進制數據或代碼的電路稱為寄存器。 寄存器是由具有存儲功能的觸發器組合起來構成的。一個觸發器可以存儲一位二進制代碼，存放N位二進制代碼的寄存器，需用n個觸發器來構成。 按功能可分為：基本寄存器和移位寄存器。 移位寄存器移位寄存器中的數據可以在移位脈沖作用下一次逐位右移或左移，數據既可以並行輸入、並行輸出，也可以串列輸入、串列輸出，還可以並行輸入、串列輸出，串列輸入、並行輸出，十分靈活，用途也很廣。 1、74LS194移位寄存器的控制輸入端S1和S0是用來進行移位方向控制的，S0為高電平時，移位寄存器處於向左移位的工作狀態，二進制數碼在CP脈沖的控制下由高到低逐位移入寄存器，因此可以實現串列輸入；在S1為低電平時，移位寄存器處於向右移位的工作狀態，二進制數碼在CP脈沖的控制下逐位移出寄存器(低位在前，高位在後)。 2、在串列輸入、並行輸出的轉換中，若將四位二進制數碼全部送入寄存器內（四位寄存器）。由於每個CP脈沖移位寄存器只移一位，四位二進制數碼需要四個CP脈沖。

③ 求四位移位寄存器使用電路圖

上次給你的電路,有一點問題,你看一下付圖,如果還有問題,再告訴我

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1.請問那一個IC,查不到?新圖多了7402這顆IC

2.此圖是空的?是圖裡面沒有電路圖嗎?

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74AS194可以用74LS194,74F194,74ACT194取代

Sorry,TTL的VCC,GND腳通常不會畫出來的,很多電路圖軟體都會自動接到VCC,Ground.所以我也沒畫出來.

這個圖的74LS194,8腳一定要接到Ground,16腳一定要接到VCC的

不止是TTLIC,很多IC的電源腳都是被電路圖軟體隱藏起來的,但是實際上是有接到VCC和Ground的,只要在那顆零件的電源腳屬性設定隱藏,就不會顯示出來的.TTLIC的電源腳,該接到VCC或Ground的腳,肯定要接到的

另外,這個電路的U2(InverterGate),U3(D-FlipFlop),U4(NorGate),這三顆TTLIC的電源腳也都沒顯示出來,肯定要接的

④ 數字邏輯實驗四位二進制數左移右移時序電路怎麼做

用一片抄四D觸發器，改變其各個觸發襲器的輸出和輸入端D的連接就可以做成左移或右移電路。
例如，片外輸入接A通道的輸入D、A通道的輸出Q接B通道的輸入D、B通道的輸出Q接C通道的輸入D、C通道的輸出Q接D通道的輸入D，這就構成從A向B、C、D方向移位，每類一次時鍾信號就會移位一次。如果片外輸入接D通道的輸入D、D通道的輸出Q接CB通道的輸入D、C通道的輸出Q接B通道的輸入D、B通道的輸出Q接A通道的輸入D，這就構成從D向C、B、A方向移位。

⑤ 由D觸發器組成的4位循環移位寄存器電路圖

把最右面的Do與最左面的Di相連就OK。

⑥ 用D觸發器設計一個四位移位寄存器

一、寄存器
寄存器是存放數碼的邏輯部件，它必須具備接收和寄存數碼的功能。採用任何一種類型的觸發器均可構成寄存器。每一個觸發器存放一位二進制數或一個邏輯變數，由n個觸發器構成的寄存器可存放n位二進制數或n個邏輯變數的值。
圖7.4.1所示為74175四D觸發器的邏輯圖。當接收命令 (即時鍾脈沖CP)到來時，數碼便送到寄存器保存起來。由於寄存器中觸發器的狀態改變是與時鍾脈沖CP同步的，故稱同步送數方式。

圖7.4.174175四D觸發器
利用觸發器的D和D也可以實現送數，達到寄存數碼的目的，其連接方式如圖7.4.2所示。這種工作方式稱為非同步送數，寄存器狀態改變的時刻與時鍾脈沖CP無關。

圖7.4.2寄存器

圖7.4.1和圖7.4.2中數碼的各位是並行送入寄存器的；寄存器寄存的數碼也是並行地將數碼的各位一齊輸出，稱為並行輸入，並行輸出。
二、移位寄存器
移位寄存器是實現移位和寄存功能的邏輯部件。
1.左移的移位寄存器
圖7.4.3(a)所示為由4級D觸發器構成的4位左移的移位寄存器，第一級觸發器的D接輸入信號vI，其餘各觸發器的D與其前一級觸發器的Q輸出相連，並將各觸發器的CP連在一起輸入移存脈沖，由圖7.4.3(a)可見：

圖7.4.3左移的移位寄存器

在移存脈沖作用下，輸入信息的現在數碼存入到第一級觸發器，第一級觸發器的狀態存入到第二級觸發器，依次類推，第i-1級觸發器的狀態存入到第i級觸發器。實現了數碼在移存脈沖作用下，向左逐位移存。圖7.4.3(b)所示為輸入信號vI=1101串列送入時Q1，Q2，Q3，Q4的波形 (設各觸發器初態為0)。由波形可看到，輸入信號每經過一級觸發器，移動了一個移存脈沖周期，但波形的形狀保持不變。
同理，讀者可自行畫出右移的移位寄存器的邏輯電路圖及工作波形圖。
上述移位寄存器工作在串列輸入、串列輸出，輸入信號經過n級移位寄存後才到達輸出端輸出，因此輸出信號比輸入信號延遲了n個移存脈沖周期，這樣就起到節拍延遲的作用，延遲時間為

其中，TCP為移存脈沖周期，n為移位寄存器位數。反之，在要求延遲時間td時，確定了移存脈沖周期TCP後，可以求出需要的移位寄存器電路的位數n。
2.雙向移位寄存器
在計算機中常使用的移位寄存器需要同時具有左移和右移的功能，即所謂雙向移位寄存器。它是在一般移位寄存器的基礎上加上左、右移存控制信號M，如圖7.4.4所示。

圖7.4.4雙向移位寄存器

由圖7.4.4可寫出各級D觸發器的特徵方程為

其中，A為右移串列輸入數碼，B為左移串列輸入數碼。當M=1時
,

因此在移存脈沖CP↑作用下，實現右移移位寄存功能。
當M=0時
,

因此在移存脈沖CP↑作用下，實現左移移位寄存功能。

⑦ 如何使用移位寄存器74ls194實現對4位二進制數進行"×2"乘法操作和"÷2"除法操作

移位寄存器74LS194由4個觸發器和它們的輸入控制電路組成。

其中DSR為數據右移串列輸入端，DSL為數據左移串列輸入端，A～D為數內據並行輸入端，QA～QD為數據並行輸出端，RD為非同步清零輸入端，S1、So為工容作狀態控制端。

寄存器 在數字電路中，用來存放二進制數據或代碼的電路稱為寄存器。 寄存器是由具有存儲功能的觸發器組合起來構成的，一個觸發器可以存儲一位二進制代碼，存放N位二進制代碼的寄存器，需用n個觸發器來構成。

(7)四位移位電路擴展閱讀：

移位寄存器不僅能寄存數據，而且能在時鍾信號的作用下使其中的數據依次左移或右移。

四位移位寄存器的原理圖如圖所示。FF0、FF1、FF2、FF3是四個邊沿觸發的D觸發器，每個觸發器的輸出端Q接到右邊一個觸發器的輸入端D。因為從時鍾信號CP的上升沿加到觸發器上開始到輸出端新狀態穩定地建立起來有一段延遲時間，所以當時鍾信號同時加到四個觸發器上時，每個觸發器接收的都是左邊一個觸發器中原來的數據(FF0接收的輸入數據D1)。寄存器中的數據依次右移一位。

⑧ 怎麼用74LS194和與非門設計一個具有自啟動功能的四位右移的環形計數器，求電路圖

s1為置數功能，是右移的1000的計數器。

利用JK觸發器設計一個非同步四進制計數器（可採用74LS73），並用示波器觀測電路輸入、輸出波形。設計一個模21的計數器（可採用74LS390或74LS192等），用發光二極體觀察並記錄電路的所有有效計數狀態。

採用數據選擇器（74LS151）設計完成下列邏輯函數：

F1= BC+A D+B D+AC ；

F2=ABC+BCD+ACD+ABD

(8)四位移位電路擴展閱讀：

根據移位方向，常把它分成左移寄存器、右移寄存器和雙向移位寄存器三種；

根據移位數據的輸入-輸出方式，又可將它分為串列輸入-串列輸出、串列輸入-並行輸出、並行輸入-串列輸出和並行輸入-並行輸出四種電路結構。

此外，有些移位寄存器還具有預置數功能，可以把數據並行地置入寄存器中。

利用移位寄存器能進行數據運算、數據處理，實現數據的串列—並行互相轉換，還可接成各種移位寄存器式計數器，如環形計數器、扭環形計數器等。

⑨ 四位移位寄存器74LS194外圍電路。

1.是的,如果電源接反了,IC會很燙.(16腳VCC要接5V,8腳是GND要接地0V)

2.(不清楚你的問題點)1腳接地時,所有輸出會清除為0,74LS194要正常工作時,1腳要接high(5V)

3.9,10腳是控制74LS194的工作模式的,很重要,

10腳9腳

highhigh輸入載到輸出

lowhigh輸出右移1個位元,QA=2腳准位

highlow輸出左移1個位元,QD=7腳准位

lowlow輸出不位移

4.11腳是一個clock,連串的方波訊號

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請問你是用手觸摸74LS194嗎?人體有雜訊的,用手摸會讓IC誤動作的.除非你是要做觸摸式的電路,那就另外需要觸摸電路了,一般都用達林頓電路當前級,再加上FlipFlop.

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我還不是很清楚,你要的電路功能,是四顆LED,循環點亮嗎?按按鍵,讓LED進入下一個循環嗎?等我弄清楚你要的功能,我才有辦法畫電路圖的

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請看附圖,是一個四循環的電路,LED會自動循環點亮

不確定你是否要用手觸摸,LED才會循環點亮,還是要"自動"循環點亮,我先用"自動"循環點亮的電路給你,如果要改成用手觸摸LED才會循環點亮,麻煩告知

⑩ 設計一個同步並行預置功能的4位左移移位寄存器，並附上電路圖及引腳設置！十萬火急，在線等，追加分！

CLK是移位時鍾信號，當CLK的上升沿到來時進程被啟動，這個時候預置使能LOAD為高電平，將輸入埠的4位二進制數並行置入移位寄存器中，作為串列左移輸出的初始值；如果預置使能LOAD為低電平，則執行語句「REG4(3DOWNTO1):=REG4(2DOWNTO0)」，此語句表明：1一個時鍾周期後將上一時鍾周期移位寄存器的低三位賦給此寄存器的高三位；2將上一時鍾周期移位寄存器中的最高位向QB輸出。隨著CLK脈沖的到來，就完成了將並行預置輸入的數據逐位向左串列輸出的功能。

LIBRARYIEEE;

USEIEEE.STD_LOGIC_1164.ALL;

ENTITYSHFRTIS

PORT(CLK,LOAD:INSTD_LOGIC;

DIN:OUTSTD_LOGIC_VECTOR(3DOWNTO0);

QB:OUTSTD_LOGIC);

ENDSHFRT;

ARCHITECTUREbehavOFSHFRTIS

BEGIN

PROCESS(CLK,LOAD)

VARIABLEREG4:STD_LOGIC_VECTOR(3DOWNTO0);

BEGIN

IFCLK'EVENTANDCLK='1THEN

IFLOAD='1'THENREG4:=DIN;

ELSEREG4(3DOWNTO1):=REG4(2DOWNTO0);

ENDIF;

ENDIF;

QB<=REG4(3);

ENDPROCESS;

ENDbehav;