纯电路设计

『壹』 纯电阻分压网络电路 设计方案，给个参考图，或者原理。邮箱[email protected]

如果你要求不高的话，可以用2个背靠背多路开关和若干电阻搭制，如果使用8路开关，可能得到64种搭配，对于大功率可以用继电器搭制，看你的需要了。数字电位器不可用吗？它更方便，可以直接用单片机进行控制。

『贰』 初中物理

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『叁』 纯数字电路的设计，单片机的设计和可编程逻辑器件，三种的优缺点

纯数字设计指的大多是74系列那样的通用芯片，有点是组建方便，简单系统成本低，是可编程逻辑器件的基础，早期单板机就用这个，现在led光屏也有很多，缺点是复杂应用成本高，设计复杂，功耗大，部分效率较低。
PLD成本高，但是功耗较低，另外较稳定易维护，方便量产。设计开发过程随着技术的进步也越来越简便快捷。
单片机功耗低应用灵活，但是执行并行任务效率低。不过一般的应用对实时性要求不高，所以应用特别特别特别广泛…收发器，收音机，充电器，显示屏，无所不在，而且沾了单片机也能显得高端不少（其实不止是显得，因为软件部分很能显示出设计者的水平）
个人见解，有不全面的楼下补充

『肆』 纯组合逻辑电路怎么dc综合

每个模块的设计工作包括3个部分：1,电路模块的设计；2,测试模块的设计；3,设计文档的编写和整理。测试模块的设计和文档编写是比电路模块设计更为重要的设计环节，测试是否严密和完整决定了系统设计的成败，设计文档的完整和准确也是系统设计成败的关键，缺少完整的设计说明文件，就不能维持设计工作的连续性，为今后的调试和维护带来困难。组合电路逻辑在数字系统中起着基本组件的作用，也可以说，如果不了解组合逻辑的构成，就不可能对数字逻辑电路系统有任何了解。采用Verilog或VHDL高层次设计方法，也是以基本组合逻辑电路为基础的。如果没有基本组合逻辑电路知识，即使对Verilog 或 VHDL 语法了如指掌，也不可能设计出结构合理的复杂系统。
在实现算法时(如卷积运算和快速傅里叶变换)，常常会用到加运算。由于多位并行加法器是由多层组合逻辑构成的，加上超前进位形成的逻辑虽然减少了延时，但还是有多级门和布线的延迟，而且随着位数的增加延迟还会积累，这样就使加法器的使用频率受到限制，这里是指计算的节拍(即时钟)必须大于运算电路的延迟，只有在输出稳定后才能输入新的数据进行下一次运算。如果设计的是32位或者是64位的加法器，延迟就会更大。为了加快计算速度，可以在运算的组合逻辑层中加入多个寄存器组来暂存中间结果。也就是采用数字逻辑设计中常用的流水线(pipe-line)办法，来提高运算速度。
这样设计的加法器在行为仿真时是没有延时的。借助综合器，可以将以上代码自动将其综合成典型的加法器结构。综合器有许多选项可供设计者选择，以便来控制自动生成的电路性能。设计者可以考虑提高电路的速度或者是节省电路元件以减少电路占用硅片的面积。综合器会自动根据你的选项为你挑选一种基本加法器的结构，有的综合器还可以根据用户对运算速度的要求插入流水线结构。

『伍』 通常所说的电路设计工程师是指什么

通信工程，电子信息，自动化专业，信息物理专业都是可以的，这个行业很多专业都有可以。行业前景应该不错，基于wto后，中国电路设计师需要集体升级，发展潜力应该不错

『陆』 用纯数字电路设计一个数字钟

伱自己设计就可以了 用555产生脉冲 再用74ls90 分频 60分频 24 分频 伱总会吧
再用CD4511 译码显示 共阳共阴随你选 只是注意译码后的电位就是了

整个电路 会用到一些 与非门 非门 或门 这个自己 弄 如果伱不会 多学习一下 相信伱弄好这个电路 这方面就不难了
我的电路图不知道弄哪去了 又没有电子图
其实电子钟就那么回事 做的方法多的去了

『柒』 我特别的热爱电子产品，考研想考一个和电子产品相关的专业，应该选择哪所学校哪个专业呢

电子信息工程就是了 成都电子科技大学 西安电子科技大学(电路与系统很好) 西北工业大学 都是电子类得好学校
你需要看的有 电路基础 数字电路基础 模拟电子线路基础 信号与系统 数字信号处理 高等数学 大学物理等等