电路分接器

㈠ 二进二出和四进的分接箱怎么看

2进线(电源),4出线(负荷)。
电缆分接箱，用来对电缆线路实施分接、分支、接续及转换电路的设备。
电缆分接箱按其电气构成分为两大类：一类是不含任何开关设备的，箱体内仅有对电缆端头进行处理和连接的附件，结构比较简单，体积较小，功能较单一，可称为普通分接箱；另一类是箱内不但有普通分接箱的附件，还含有一台或多台开关设备，其结构较为复杂，体积较大，连接器件多，制造技术难度大，造价高，可称为高级分接箱。

㈡ 什么是电缆分接箱和环网柜一样功能吗

安徽环网电气分界箱最专业，十项专利，合肥各个小区，道路上大批选用

电缆分接箱是一种用来对电缆线路实施分接、分支、接续及转换电路的设备，多数用于户外。该设备在我国使用时间不长，业内人士和电力系统使用部门对它的认识和理解尚不一致，特别是对引自国外的欧式和美式接插器件等存在不同的看法。以下对电缆分接箱的相关技术要素作简单介绍和论述，供电力设计和运行部门参考。� 电缆分接箱的类型
电缆分接箱按其电气构成分为两大类：一类是不含任何开关设备的，箱体内仅有对电缆端头进行处理和连接的附件，结构比较简单，体积较小，功能较单一，可称为普通分接箱；另一类是箱内不但有普通分接箱的附件，还含有一台或多台开关设备，其结构较为复杂，体积较大，连接器件多，制造技术难度大，造价高，可称为高级分接箱。
1. 普通分接箱
普通分接箱内没有开关设备，进线与出线在电气上连接在一起，电位相同，适宜用于分接或分支接线。通常习惯将进线回数加上出线回数称为分支数。例如三分支电缆分接箱，它的每一相上都有三个等电位连接点，可以用作一进二出或二进一出。电缆分接箱内含U，V，W三相，三相电路结构相同，顺排在一起。
2. 高级分接箱
高级分接箱内含有开关设备，既可起普通分接箱的分接、分支作用，又可起供电电路的控制、转换以及改变运行方式的作用。开关断口大致将电缆回路分隔为进线侧和出线侧，两侧电位可以不一样。开关设备本身有较大的体积，因此高级分接箱的外形尺寸比较大，高度一般为1.4～1.8 m，深度约为0.9～1.0 m，长度则依所含开关设备数目而定，多在1.0 m至2.4 m之间。箱体的外形类似于户外箱式变压器，箱壳上有若干个活动的门，有的门是为开关设备的操作而设，有的门是为电缆连接器件的安装施工或维护检修而设的。

㈢ 急，用VHDL设计同步分接器的电路原理谁有啊

同步数字复接的设计及其FPGA实现
作者： 发布时间：2005-08-02

摘要：在简要介绍同步数字复接基本原理的基础上，采用VHDL语言对同步数字复接各组成模块进行了设计，并在ISE集成环境下进行了设计描述、综合、布局布线及时序仿真，取得了正确的设计结果，同时利用中小容量的FPGA实现了同步数字复接功能。

关键词：同步数字复接/分接 FPGA位同步 帧同步检测

基群速率数字信号的合成设备和分接设备是曜网络中使用较多的关键设备，在数字程控交换机的用户模块、小灵通基站控制器和集团电话中都需要使用这种同步数字复接设备。近年来，随着需要自建内部通信系统的公司和企业不断增多，同步数字复接设备的使用需求也在增加。FPGA（现场可编程门阵列）器件的高性能简化了数字通信系统的设计与实现。本文基于FPGA的技术特点，结果数字复接技术的基本原理，实现了基群速率（2048kbps）数字信号的数字分接与复接。

1 同步数字复接的基本原理

在数字通信网络中，为了扩大传输容量和传输效率，常常需要把若干个低速数字信号合并成为一个高速数字信号，然后通过高速信道传输；而在接收端又按照需要分解成低速数字信号。数字复接技术就是实现这种数字信号合并（复接）和分解（分接）的专门技术[1]。

1.1 系统划分

同步数字复接终端包括同步数字复接器(Synchronous Digital Multiplexer)和同频数字分接器(Synchronous Digital Demultiplexer)两部分，如图1所示。数字复接器把两个或两个以上的支路数字信号按时分复用方式合并成单一的合数数字信号；数字分接器把单一的合数数字信号分解为原来的各支路数字信号。通常总是把数字复接器和数字分接器装在一起做成一个设备，称为复接分接器（Muldex），一般简称数字复接设备[2]。

同步数字复接器由定时和复接单元组成；定时单元给字分接器则由同步、定时和分接单元组成。定时单元给设备提供各种定时信号，复接器的主时钟可由内部产生，也可由外部提供，而分接器主时钟则从接收信号中提取，并通过同步电路的高速整控制，使得分接器基准时序信号与复接器基准时序信号保持正确的相位关系，即收发同步。同步的建立由同步单元实现[1]。

1.2 位同步[3]

在数字通信中，位同步是最基本的同步。位同步的基本含义就是收端和发端时钟信号必须同频同相，这样接收端才能正确接收和判决发送端送来的每一个码元。为了达到收发端时钟同频同相，接收端需要从收到的码流中提取发送端的时钟信号来控制收端时钟，从而做到位同步。实现位同步的方法分为插入导频法和直接法两类。而直接法按照提取同步信号的方式，大致又可分为滤波法和锁相法。锁相法的原理是：在接收端用鉴相器比较接收码元和本地产生的位同步信号的相位，如果两者不一致，则用鉴相器输出误差信号去控制本地同步信号的相位，直至本地的位同步信号的相位与接收信号的相位一致为止。

1.3 帧同步

在复接分接器中，如果只是循环交织地复接各支路数字信号，那么一旦合并成为一个合路数字信号后就难以正确地实施分接。为了保证接收端分路系统能和发送端一致，在保持位同步的基础上还必须要有一个帧同步系统，以实现发送端与接收端的帧同步[2]。

实现帧同步的基本方法是在发送端预先规定的时隙（即帧同步码时隙）插入一组特殊码型的帧同步码组；在接收端由帧同步检测电路检测该码组以保证收发帧同步[2]。

帧同步检测状态有失步态、同步校核态、同步态和同步保护态四种状态。

2 基于FPGA的同步数字复接的设计与实现

FPGA/CPLD即继承了ASIC的大规模、高集成度、高可靠性的优点，又克服了普通ASIC设计的设计周期长、投资大、灵活性差的缺点，逐步成为复杂数字电路设计的理想首选[4]。

ISE是XILINX公司提供的一个开发FPGA/CPLD的集成环境，其集成的工具可以完成从设计输入、功能仿真、综合优化、综合后仿真、布局布线、时序仿真到配置芯片等整个FPGA。CPLD开发过程。

本设计采用ISE集成环境进行开发，使用SPARTAN-3系列FPGA器件实现设计。

2.1 按骊字复接系统的设计

数字信号复接主要有两种方式[1]：一种是“逐位复接”，另一种是“按码字复接”。其中按码复接方式保留了码字结构，有利于多种合成处理和交换。本设计要实现32路信号的复接，信息位采取各支路彼此循环且每次插入一个8位信息位到合路数字信号中的码字复接形式，帧同步码采用CCITT推荐的10011011。

2.1.1 复接器和分接器的设计

复接器应完成两个功能。一是循环接收32个64kbps的支路信号，每个支路每次送入8位信息位（其中第一支路送入固定的帧同步码10011011），形成合路数字；二是将合路数据以2048kbps的速率发送出去，形成合路信号——基群速率信号。

同步数字复接器电路原理图如图2所示，复接器由移位寄存器和定时模块两部分构成。移位寄存器分两组，每组由32个8位移位寄存器组成。在一帧时间（125μs）内，当其中一组移位寄存器在64kHz时钟控制下同时移入32个支路的数据时，另一组移位寄存器个支路的数据依次送出。在下一帧时间内，则由第一组移位寄存器输出2048kbps的合路信号，第二组移位寄存器读入32个64kbps的支路数据。依此规律，在定时模块的控制下，由两组移位寄存器交换变换工作任务，实现了支路输入和合路输出的连续性。定时模块由计数器(cnt)、多路选择器(mu12~mu15)等组成，为两组移位寄存器提供工作允许信号、合路信号输出的切换选择信号。

为了提高时钟的可靠性、降低时钟的延时抖动、提高时钟的驱动能力，从而更好地完成同步复接，利用FPGA自身提供的全局时钟资源驱动本设计的主时钟，将外部时钟从芯片的全局时钟管脚输入，经过BUFGP（IBUFG BUFG）后通过全局时钟网络送至同步复接部分。

分接器的功能与复接器相反。分接器在其定时单元的控制下，对两组移位寄存器进行2048kbps的数据写入和64kbps的数据读出，实现基群速率合路数字信号的32路分接。

2.1.2 位同步提取电路的设计

实现合路数字信号的分接，需要从数据流中提取时钟同步信息。目前，在数字通信系统中，常常采用数字锁相法提取位同步信号[3]。

位同步提取电路如图3（a）所示，主要由微分与鉴相模块、添门/扣门控制模块、高频时钟模块以及分频器(clk_gen)等部分组成。微分电路(diff)的功能是把非归

零码转换为归零码，以利于定时信息的提取。鉴相器的功能是比较接收码元（code_in）与分频器输出的本地时钟信号(clk_out)的相位，若本地时钟超前于接收码元的相位，鉴相器向扣门电路输出一个超前脉冲，在16分频器输入端扣除一个高频窄脉冲，使分频器输出的时钟信号和相位滞后1/16周期；若本地时钟滞后于接收码元的相频窄脉冲，使分频器的输出脉冲的相位提前1/16周期。高频时钟模块将本地高频时钟输入信号clk_in转换为两路相位差为90°的窄脉冲序列，分别为添门和扣门提供高频窄脉序列。添门为常闭门，在没有滞后脉冲控制时，此门始终关闭；扣门为常开门，若无超前脉冲控制时，窄脉冲信号通过此常开门。分频器将输入的高频时钟信号分频后输出位同步信号clk_out。

对位同步提取电路进行时序仿真，得到的时序仿真波形图如图3(b)所示。图中，code_in为输入码流，clk_out为位同步信号输出。由图可知，该电路可以从输入码流中准确提取位同步信号，并且在码流相位有变化的时，位同步信号可以快速地做出相位调整，保持同步。

2.1.3 帧同步单元的设计

为了正确地实施分接，在分接前必须先通过帧步单元对合路信号进行帧同步检测。

帧同步单元是复接设备中较复杂也很重要的部分。如图4所示，它主要由同步码检测模块(chk)和同步检测控制模块（chk_ctrl）两部分组成。其中，同步码检测模块对输入的数据流进行搜索，一旦检测到帧同步码(10011011)，立即输出一个捕获脉冲信号（gen）；同步检测控制模块由帧同步系统状态计数器和一帧计数器等构成，完成帧同步单元的状态转换控制、每帧检测同步头的控制等功能。

帧同步的关键部分是前方保护和后方保护的设计。为了减少从失步到重新获得同步的时间和减小信道误码对同步工作状态的影响，从而得到较好的通信质量，本设计采用了2帧后方保护和3帧前方保护的方案。

帧同步系统状态转换图如图5所示。系统工程上电复位后，在起始时刻处于失步状态（STATE0_1xx——其中x表示无关值），系统从外部输入的合码路流中搜捕帧同步码“10011011”，若合路码流中没有帧同步码，状态计数器仍保持为1xx；若从合码路流中检测同步码（get="1"），则状态计数器清零为000，系统进入同步核校态（STATE1_000），开始将合路码流写入移位寄存器，分接器输出开关仍然为关闭状态（switch="0"）。在同步校核状态下，若下一帧确认帧同步码不正确，判断为虚假同步，则状态计数器减1变为111，系统回到失步态；相反，若下一帧确认帧同步确正确，则系统进入同步态（STATE2_001），分接器输出开关打开（switch="1"），开始正常分接合路码流。系统进入同步态后，若合路码流中出现帧同步码丢失，则状态计数器加1，系统进入同步保护态1（STATE3_010）；若下一帧仍然检测帧同步码失败，则状态计数器再加1，系统进入同步保护态2（STATE4_011）；若连续第三帧未收到帧同步码，则状态计数器再加1转为100，系统进入失步状态，停止分接合路码流（switch="0"），同时重新开始搜搏帧同步码“10011011”。系统在同步保护态（状态计数器值为01x）下，若检测帧同步码正确，则状态计数器置数为001，系统回到同步态。

2.2 系统仿真与验证

在ISE集成环境下，调用ModelSim仿真软件对系统各模块进行功能仿真、综合后仿真以及布局布线后的时序仿真。仿真结果表明，复接器、分接器、同步单元等所有模块的设计均满足设计要求。

图6

为了进一步确保系统设计的可实用性，将系统各组成模块按照自环工作状态连接起来，对系统各模块进行了联合仿真。复接设备自环验证的原理图如图6所示。

将32路64kbps的支路信号Ts_sin(31:0)送到复接器(multiplexer)的支路信号输入端Ts(31:0)，复接器的合路信号输出端E1_out与同步单元syn_mole(包括位同步和帧同步)的合路信号输入端E1_in相连（自环），合路信号经过位同步信号提取以及帧同步检测后，由同步单元将非失步状态下的合路序列从信号输出端E1_out送出，同步单元还提供位同步信号clk_out，送分接器demultiplex的输入端xclk-2M，同步单元输出的合路序列送入分接器的合路信号输入端E1_in，经过分接器实施分接后，最后从支路输出控制单元output_gate的输出端可以得到各个支路的输出信号Ts_out(31:)。

图7为复接设备自环验证的仿真时序图。其中，Ts_in为32个支路送来的64kbps的激励信号；mul_E1_out为经复接器实施复接后的合路信号；E1_check_in为进入帧同步码检测模块的合路序列；get_syn为帧同步码检测的结果；one_fr为同步校核和同步保护所需的帧 步码检测控制信号；syn_n为系统失步信号；syn_E1_out为非失步状态下的合路序列；opn为支路信号输出允许信号；Ts_out为实施分接后各支路的64kbps输出信号；Ts_in(1)为复接器第一支路输入信号；Ts_out(1)为分接器第一支路输出信号。

将输入激励信号Ts_in与系统支路输出信号Ts_out相比较，结果表明，在从同步到下一次失步的时间内，Ts_out与Ts_in信号波形基本一致——Ts_out中会出现一些1~2ns的过渡值，这些过渡值是由于Ts_out总线中32个支路信号到达寄存器输出端的时间不一致而造成的，这是由FPGA器件时延不确定性决定的。由Ts_in(1) 和Ts_out(1)的波形比较可知，对于每个单一的支路信号，并不存在这种过渡值，分接后的分路信号与复接器支路输入信号一致。因此，Ts_out总线中出现的这种过渡值不会影响系统的性能。

时序仿真结果表明，复接、同步以及分接功能均正常，满足设计要求。在5万门的SPARTAN-3系列FPGA器件xc3s50上实现设计，硬件资源的使用情况如下：319个Slice，263个Slice Flip Flop，562个4 input LUT，70个bonded IOB,2个GCLK。该设计已作为一个模块应用到其它系统中，具有一定的实用价值。同时，由于该技术采用VHDL语言描述，具有可移植性，利用中小容易的FPGA就能实现该系统功能。

㈣ 有线电视分配器作用及原理介绍

在我们的生活中，我们大家应该都看过电视吧，最初的是黑白电视，随着科技的发展，发明了彩色电视，现在几乎每个家庭都有电视，电视机本身是没有节目的，只要我们给电视机装上有线天线，这样我们就可以看到很多的电视频道，通过看电视可以很好的放松我们自己，我们要知道，有线电视的配备设备中有分配器，下面小编就来给大家介绍一下它的作用。

有线电视的分配器是用来分配有线电视信号的器材。每个用户的信号都是从分配器分配进入我们每家每户的。例如：一分二有两种，一种是一分支器(IN，OUT，BR)还有就是二分配器(IN，OUT，OUT)信号进线接IN，两个OUT分别接用户电视。

原理：

有线电线分配器原理就是通过一些电阻电容电感的阻抗变换匹配电路合理分配信号，使各路输出端的信号互相不受影响，并且也不会影响到输入端的信号，但是分配器是有一定衰减作用的。

作用一：

1.有线电视的分配器可以用于分配信号，譬如三分配器就是用于将一路信号平均分配成为三路，但在分配信号的同时也会带来分配损失，以三分配器为例，它的分配损失就是6dB，也就是说它的每一路信号都比原来的信号强度要减少6dB。

按照有线电视线路的标准，一般用户连接一个四分配器是不需要再加放大器的。

有线电视分配器对信号功率的分配分量大小用db(分贝)表示，这是一个相对量，类似我们日常所熟悉的倍数。例如：我们把一个信号按1/2平均分配，每个信号即为0.5。换算成分贝表示即：lg0.5(取0.5的对数)X10-3db,因此，在理论上，把一个信号一分为二，这个信号即减小了-3db。但在实际运用中，这些器件都不是理想化的。所以，实际衰减要稍大于理论值。

作用二：

有线电视分配器不但具有功率信号的分配功能，更重要的是它在分配信号的同时，对端口的是设备起到阻抗匹配的作用，这在高频宽带电路中是非常重要的。

关于有线电视的分配器作用已经告诉了大家，其实分配器的作用在我们的生活中是很重要的，因为很多家庭都有电视，所以就可能会接触到分配器，分配器是和信号有关系的，而我们看电视又离不开信号，所以说感兴趣的朋友可以对这方面的知识多加了解，我们会发现，生活中有很多需要我们学习和了解的知识，希望我们大家都可以从生活中不断的学习。

㈤ 家装电路是串联还是并联为什么

家庭装修的电路是允许有并联和串联的。其实知友所说的是存在一些问题的。在装修是厨房的布线是很有讲究的，首先要考虑冰箱单独走一路线，这样如果出门旅游了其他电路闭合，只留冰箱正常工作。其次是所有的插座单独走一路专线，这里注意装修前厨房计划所用的电器，告诉电工师傅，师傅会根据他们的专业经验来确定用对应的电线材料的.最后就是照明单独走一路专线，这里用串联没有问题的。其他家庭装修中功率过大的电器一定要并联布置，比如空调、即热型热水器、浴霸等。

㈥ 汽车电路连接器件包括什么

电路连接器件包括导线，线束和连接器。

1.导线

汽车电系所用的导线有低压线、屏蔽线和高压线3种。

1)汽车用低压导线的颜色与代号：随着汽车电器的增多，导线数量也不断增加，为了便于维修，低压导线常以不间的颜色加以区分。其中截面在4m㎡以上的采用单色，而4m㎡以下的均采用双色。2)屏蔽导线。屏蔽导线主要用作各种传感器和电子控制装置的信号线等。这种导线内只有电压程E的微弱信号电流通过，为了不受外界的电磁感应干扰（或火花塞点火时、电器开关开闭时产生的干扰)，在其线芯外除了有一层绝缘材料外，还覆有一层屏蔽用的导体，最外层为保护用外皮。3）高压导线。用来传送点火电压，由于工作电压很高(一般在15kV以上)，电流较小，因此高压导的绝缘包层很厚，耐压性能好，但线芯截面很小。

综上所述，电路连接器件包括导线，线束和连接器。电盒等。汽车电器系统配电器件主要包括电路连接器件、电路控制器件、电路保护器件和中央配电盒。

㈦ 电缆分接箱的电缆分接箱的类型

电缆分接箱按其电气构成分为两大类：一类是不含任何开关设备的，箱体内仅有对电缆端头进行处理和连接的附件，结构比较简单，体积较小，功能较单一，可称为普通分接箱；另一类是箱内不但有普通分接箱的附件，还含有一台或多台开关设备，其结构较为复杂，体积较大，连接器件多，制造技术难度大，造价高，可称为高级分接箱。
1. 普通分接箱
普通分接箱内没有开关设备，进线与出线在电气上连接在一起，电位相同，适宜用于分接或分支接线。通常习惯将进线回数加上出线回数称为分支数。例如三分支电缆分接箱，它的每一相上都有三个等电位连接点，可以用作一进二出或二进一出。电缆分接箱内含U，V，W三相，三相电路结构相同，顺排在一起。
2. 高级分接箱
高级分接箱内含有开关设备，既可起普通分接箱的分接、分支作用，又可起供电电路的控制、转换以及改变运行方式的作用。开关断口大致将电缆回路分隔为进线侧和出线侧，两侧电位可以不一样。开关设备本身有较大的体积，因此高级分接箱的外形尺寸比较大，高度一般为1.4～1.8 m，深度约为0.9～1.0 m，长度则依所含开关设备数目而定，多在1.0 m至2.4 m之间。箱体的外形类似于户外箱式变压器，箱壳上有若干个活动的门，有的门是为开关设备的操作而设，有的门是为电缆连接器件的安装施工或维护检修而设的。

㈧ 家用电路4平方线二进房间分2条2.5平方、1条1.5平方线用分线器接好还是几根线纽接在一起好

一般都是组接在一起，比用接线端子接线的接触电阻小，且由绝缘胶带包裹，无外露，更安全。

㈨ 关于分路器的原理和电路

分路器是用来使电话通道与数据通道分离的装置。

原理：熔融拉锥型产品是将两根或多根光纤进行侧面熔接而成；平面波导型是微光学元件型产品，采用光刻技术，在介质或半导体基板上形成光波导，实现分支分配功能。这两种型式的分光原理类似，它们通过改变光纤间的消逝场相互耦合（耦合度，耦合长度）以及改变光纤纤半径来实现不同大小分支量，反之也可以将多路光信号合为一路信号叫做合成器。熔锥型光纤耦合器因制作方法简单、价格便宜、容易与外部光纤连接成为一整体，而且可以耐孚机械振动和温度变化等优点，目前成为市场的主流制造技术。

与同轴电缆传输系统一样，光网络系统也需要将光信号进行耦合、分支、分配，这就需要光分路器来实现。光分路器常用M×N来表示一个分路器有M个输入端和N个输出端。在光纤CATV系统中使用的光分路器一般都是1×2、1×3以及由它们组成的1×N光分路器。

用于PON网络的光分路器按功率分配形成规格来看，光分路器可表示为M×N，也可表示为M：N。M表示输入光纤路数，N表示输出光纤路数。在FTTx系统中，M可为1或2，N可为2、4、8、16、32、64、128等。本标准统一用M×N表示。

电路：

㈩ 求电路中的分流器是起什么作用的、工作原理

1、分流，分压。通常是用一个毫
V
表，挎接在一段锰铜丝或者其它材料两端。通常这种材料具有低温度系数，电阻小的特点。我们知道，流过一个固定电阻的电流是随两端电压的变化而变化的，也可以这样看：电阻上的电流变化了，电压也一定发生了变化。电流表所使用的分流器也是利用了这个原理，用一个毫V表测量分流器（一个阻值很小的电阻）两端的电压。
和你说的陶瓷可变电阻配合配合，并联在一起就是分流作用，传连在一起是分压作用
3、电路中的分流器是起什么作用的？工作原理是怎么样的？可否详细一点解释？
分流器是指黄铜和锰铜制作的那种。
分流器是测量直流电流用的；
实际就是一个阻值很小的电阻，当有直流电流通过时，产生压降，供直流电流表显示；
直流电流表实际是电压表，满度值75mV；
直流电流表和是配套使用的；
比如：100A电流表配套的阻值为0.00075欧；
即100A*0.00075欧=75mV；
50A电流表配套的阻值为0.0015欧；
50A*0.0015欧=75mV。